Responsibility:
1、基于FPGA平台完成SoC原型系统开发
2、完成RTL设计的FPGA实现,包括代码修改、仿真、综合及布局布线
3、完成FPGA时序和性能的优化工作
4、支持BSP和软件算法团队完成驱动程序的开发和调试工作
Qualification:
1、计算机或电子等专业硕士及以上学历,985、211和海外知名高校毕业者优先
2、熟悉Verilog/VHDL语言及相应的RTL仿真工具,熟悉FPGA开发流程
3、熟练掌握FPGA性能优化和调试技巧
4、具有团队合作精神,很强的分析解决问题和学习新技术的能力
5、有处理器或AI加速器开发相关经验者优先Responsibility:
1、参与复杂IP如AI加速器以及异构SOC的架构定义,制定功能设计规范
2、算法理解和模块级RTL设计、仿真验证及综合
3、SOC的集成和仿真
4、参与FPGA验证
Qualification:
1、电子计算机相关专业,硕士及以上学历(985、211或海外知名高校优先)
2、熟悉计算机体系结构,了解深度学习架构如卷积神经网络CNN原理
3、了解Verilog/VHDL语言,使用Synopsys或Cadence仿真工具
4、了解SystemVerilog及UVM验证方法者优先
5、了解python、tcl等语言
6、具备较强的分析问题和解决问题的能力,具有较强的学习能力、团队精神、责任感、积极主动、沟通能力强Responsibility:
1、参与IP和SOC的仿真验证和FPGA原形验证
2、根据设计规范制定验证方案
3、编写和维护测试基准,完成回归测试
4、验证环境及平台的开发和优化
Qualification:
1、电子计算机相关专业,硕士及以上学历(985、211或海外知名高校优先)
2、了解Mentor Veloce FPGA emulator或Cadence Palladium XP硬件仿真加速验证平台
3、熟悉Verilog语言及仿真技术,熟悉SystemVerilog和UVM者优先
4、熟悉C/C++语言,熟悉LINUX下Shell/Tcl/Python等脚本编程
5、熟悉SOC总线(AMBA, NoC等)
6、有SOC验证经验者优先办公时间(节假日除外)
上午:8:30-12:00 下午:13:30-17:30
联系地址
浙江大学紫金港校区西区学生服务中心(尧坤楼)2楼
联系方式
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